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基于软件无线电的TD-LTE物理层链路协议研究与仿真开题报告

 2020-02-10 11:02  

1. 研究目的与意义(文献综述)

td-lte(time division - long term evolution分时长期演化),又名lte-tdd ,是基于ofdma技术、3gpp组织制定的全球通用标准,现已正式成为4g的执行标准。lte是在3g技术之后发展的,它改进并增强了3g的空中接入技术,采用了ofdm和mimo作为其无线电网严谨的核心技术,提供百兆级比特率的上下行移动宽带介入,具有资源配置灵活、频谱利用率高、低时延的突出优点,满足了新业务的增长需求,被视为3g向4g严谨的主流标准,获得了业界的普遍认同和广泛支持。

自从2008年开始,lte得到标准化和产业化,并得到运行商的广泛支持,之后便迎来了迅猛发展。现在国际上td-lte在国际上不断地发展,lte-a,unlicense-lte,small cell等被不断的提出,也显著的可以看出国际上并没有停止对lte的研究。同时,作为td-scdma的演进技术,td-lte继承了一些以往的核心专利,但与此同时,随着中国产业力量的不断增强,而且参与研发td-lte起步比较早,相比于3g时有了很大部分的核心专利权。总的来说,中国还有望向更高一步发展。

lte系统现在已经完全投入商用,能够以高速率、低延迟来传输信息。在空中接口方面使用ofdm、fdma 代替传统的3gpp使用的码分多址技术、并且采用mimo技术提高数据速率。

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2. 研究的基本内容与方案

研究TD-LTE协议的物理层链路的协议规范,包括研究帧结构和物理信道(帧结构和物理信道)、物理层过程(小区搜索过程、功率控制过程、上行链路同步过程、随机接入过程、混合自动重传过程);通过学习书籍和阅读文献,了解4G移动通信技术和TD-LTE系统,设计TD-LTE通信系统,其中采用MATLAB和LabVIEW对TD-LTE物理层模块进行功能仿真,搭建系统进行联调,对系统功能进行测试和优化。

实现对于TD-LTE链路级的仿真,本质上就是实现接收端与发送端的信号传输,在传输的过程中使用TD-LTE采用的对信号进行处理的关键技术。传统的链路级仿真系统一般包括三个部分:信号的发送部分、信号接收部分以及信道部分。TD-LTE的下行共享的过程处理中,包含了信号的传输、HARQ重传、信道自适应调制与编码、时间频率同步等过程,能够较好的反应TD-LTE系统的链路级特性。真实的TD-LTE系统中,基带信号处理的过程非常复杂,为了简化基带信号的处理过程以保证仿真系统的效率,同时还要保持仿真系统能够准确的反应真实的TD-LTE系统的特性,在操作中需要进行简化。

3. 研究计划与安排

第1-3周:查阅相关文献资料,明确研究内容,了解研究所需原理和技术。确定方案,完成开题报告;

第4周:阅读相关文献,进一步加深对td-lte和软件无线电技术的了解,进行英文文献的翻译工作;

第5周:了解td-lte物理层链路协议的组成,学习如何搭建链路;

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4. 参考文献(12篇以上)

[1]赖文昌. 基于软件无线电平台的TD-LTE链路级仿真平台的实现[D].北京邮电大学,2015.
[2]高杰. TD-LTE下行物理层信道估计技术研究[D].南京邮电大学,2016.
[3]DOKOU ELOM KODJO. LTE下行链路物理层信道估计技术研究[D].哈尔滨工业大学,2017.
[4]王晓艳,徐高魁.TD-LTE基站网络优化方法研究[J].电子世界,2019(01):40-41.
[5]张瑾,周原. 基于MATLAB/Simulink的通信系统建模与仿真[M].北京:北京航空航天大学出版社,2017.
[6]李正茂. TD-LTE应用与实践[M].北京:人民邮电出版社,2014.
[7]韩志勇. TD-LTE核心网质量提升及信令研究[D].南京邮电大学,2017.
[8]石荣,李潇,杜宇,徐剑韬.TD-LTE下行链路侦收中小区物理层ID的快速获取[J].电子信息对抗技术,2017,32(06):48-53 86.
[9]邓晓昺.TD-LTE无线通信关键技术研究与探讨[J].中国新信,2017,19(20):10.
[10]刘相志,王代强,戴晨亮.一种TD-LTE系统上行资源分配新算法[J].电子科技,2017,30(12):79-82.
[11]刘利田. TD-LTE下行物理层的研究和实现[D].北京邮电大学,2017.
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[14]Yang L, Li T. box-folded four-element MIMO antenna system for LTE handsets[J].Electronics Letters,2015,51(6):440-441.
[15]Verma S, Kumar S. High-performance VLSI architectures for turbo decoders with QPP interleaver[J]. International Journal of Electronics,2015,102(4):1-20.
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